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通(tòng)过(guò)FPGA、SOC、GPU並(bìng)行處(chù)理(lǐ)架構及(jí)PCIe高(gāo)速接口(kǒu),为(wèi)AI推理(lǐ)、信号(hào)處(chù)理(lǐ)、金(jīn)融分(fēn)析等計(jì)算密集型任務(wù)提(tí)供強(qiáng)大(dà)的(de)硬(yìng)件(jiàn)加速能(néng)力,是數據(jù)中心和(hé)邊(biān)緣計(jì)算的(de)核心算力引擎。

  1. BAC300 (PCIe2.0X8, 2*10G)
  2. BAC400/410 (PCIe3.0x8, 2*40G)
  3. BAC500 (PCIe3.0x16, 2*100G)
  4. BAC510 (PCIe3.0x16, 2*100G)

射頻直(zhí)采单元(yuán)基于(yú)高(gāo)度(dù)集成(chéng)的(de)RFSoC芯片(piàn)與(yǔ)高(gāo)速PCIe接口(kǒu)構建,用(yòng)于(yú)射頻信号(hào)采集與(yǔ)處(chù)理(lǐ)、信道(dào)模拟、任意(yì)波(bō)形發(fà)生、頻譜分(fēn)析等,可(kě)以(yǐ)與(yǔ)标(biāo)準PCIe設備的(de)組件(jiàn)模块(kuài)快(kuài)速整合。

  1. BFX780 (8T8R, PCIe3.0x16)

基于(yú)RFSOC、ADDA、RFIC等芯片(piàn),構建模块(kuài)化(huà)的(de)射頻功能(néng)单元(yuán),通(tòng)常以(yǐ)标(biāo)準FMC接口(kǒu)與(yǔ)底闆搭配使用(yòng)。

  1. BDX109 (ADRV9009, 4T4R)

提(tí)供包(bāo)括上(shàng)下(xià)变頻器、矩阵(zhèn)開(kāi)關(guān)、微波(bō)組件(jiàn)、TMH組件(jiàn)、天(tiān)線(xiàn)、濾波(bō)器等多(duō)種(zhǒng)規格組件(jiàn),快(kuài)速的(de)搭建目标(biāo)解(jiě)決方(fāng)案(àn)系(xì)統。

  1. GPSDO模块(kuài)
  2. 微波(bō)天(tiān)線(xiàn)
  3. 微波(bō)信号(hào)放(fàng)大(dà)模块(kuài)
  4. 微波(bō)擴展(zhǎn)模块(kuài)
  5. 太赫茲擴展(zhǎn)模块(kuài)

从信号(hào)的(de)發(fà)生、采集、存儲、回放(fàng),到(dào)信号(hào)的(de)分(fēn)析,以(yǐ)及(jí)基于(yú)GPU的(de)AI模型,智能(néng)信号(hào)的(de)訓練與(yǔ)開(kāi)發(fà),信号(hào)的(de)流图(tú)式開(kāi)發(fà)以(yǐ)及(jí)部(bù)署(shǔ)測試,均提(tí)供对(duì)應(yìng)的(de)工具软(ruǎn)件(jiàn)。


  1. bhSDR Studio-射頻數據(jù)采存放(fàng)及(jí)分(fēn)析软(ruǎn)件(jiàn)
  2. bhSDR VSG-任意(yì)波(bō)形發(fà)生软(ruǎn)件(jiàn)
  3. bhSDR AI-智能(néng)信号(hào)訓練與(yǔ)開(kāi)發(fà)软(ruǎn)件(jiàn)

實(shí)現(xiàn)數字(zì)信号(hào)處(chù)理(lǐ)算法(fǎ)的(de)可(kě)複用(yòng)硬(yìng)件(jiàn)模块(kuài),用(yòng)于(yú)濾波(bō)、变換(FFT)、編解(jiě)码、預處(chù)理(lǐ)、变頻等环(huán)节(jié),标(biāo)準的(de)多(duō)種(zhǒng)IP可(kě)以(yǐ)簡化(huà)開(kāi)發(fà)流程。

  1. DDC(Digital Down Converter)
  2. DUC(Digital Up Converter)
  3. FFT(Fast Fourier Transform)
  4. PDDC( Polyphase Digital Down Converter )
  5. PDUC( Polyphase Digital Up Converter )
  6. PLF( Polyphase Lowpass Filter)
  7. DCR( Direct Current Removal)
  8. 數字(zì)AGC( Automatic Gain Control)

基于(yú)对(duì)多(duō)種(zhǒng)開(kāi)源软(ruǎn)件(jiàn)及(jí)第(dì)三(sān)方(fāng)協議棧的(de)支持(chí),bhSDR系(xì)列软(ruǎn)件(jiàn)硬(yìng)件(jiàn)能(néng)滿足無線(xiàn)電(diàn)領域的(de)絕大(dà)部(bù)分(fēn)需求,包(bāo)括使用(yòng)Matlab、UHD、LabVIEW、PYNQ等场(chǎng)景,以(yǐ)及(jí)類(lèi)似OAI、OpenWIFI这(zhè)類(lèi)複雜協議棧。

  1. Matlab&SIMULINK
  2. UHD
  3. LabVIEW
  4. RFNoC
  5. OAI(Open Air Interface)
  6. GNURadio
  7. PYNQ
  8. OpenWIFI

SDR産品的(de)靈活可(kě)重(zhòng)定(dìng)義特(tè)性(xìng),決定(dìng)了(le)其在(zài)通(tòng)信領域發(fà)揮了(le)越来(lái)越重(zhòng)要(yào)的(de)作(zuò)用(yòng),類(lèi)似于(yú)在(zài)5G、6G、衛通(tòng)、太赫茲、毫(háo)米(mǐ)波(bō)、WIFI、通(tòng)感(gǎn)一(yī)體(tǐ)等領域。

  1. 解(jiě)決方(fāng)案(àn) - 5G綜測儀/NTN/基站整體(tǐ)解(jiě)決方(fāng)案(àn)
  2. 應(yìng)用(yòng)案(àn)列-5G(OAI)開(kāi)源通(tòng)信验(yàn)證平台
  3. 解(jiě)決方(fāng)案(àn) - THZ(太赫茲)通(tòng)信系(xì)統平台
  4. 解(jiě)決方(fāng)案(àn) - 基于(yú)OFDM的(de)點(diǎn)到(dào)點(diǎn)高(gāo)清(qīng)图(tú)傳方(fāng)案(àn)

在(zài)數據(jù)采集、測向(xiàng)分(fēn)析等、智能(néng)信号(hào)處(chù)理(lǐ)、信号(hào)源、頻譜儀、信道(dào)模拟等領域,SDR以(yǐ)其低(dī)成(chéng)本(běn)、可(kě)重(zhòng)構優勢,也(yě)在(zài)各个(gè)領域不(bù)斷得到(dào)應(yìng)用(yòng)。

  1. 基于(yú)bhSDR的(de)阵(zhèn)列雷(léi)达(dá)測向(xiàng)系(xì)統
  2. 宽(kuān)带(dài)多(duō)通(tòng)道(dào)同(tóng)步采集系(xì)統方(fāng)案(àn)
  3. 极(jí)低(dī)成(chéng)本(běn)矢量(liàng)信号(hào)源/任意(yì)波(bō)形發(fà)生器方(fāng)案(àn)
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bhSDR AI-智能(néng)信号(hào)訓練與(yǔ)開(kāi)發(fà)软(ruǎn)件(jiàn)
産品描述

bhSDR是彬鴻科技推出的(de)新一(yī)代智能(néng)软(ruǎn)件(jiàn)無線(xiàn)電(diàn)平台,深度(dù)融合SDR硬(yìng)件(jiàn)平台與(yǔ)NVIDIA Jetson AI算力模块(kuài),闆载的(de)Jetson AI模块(kuài)支持(chí)所(suǒ)有(yǒu)通(tòng)用(yòng)的(de)AI框架,将SDR系(xì)統與(yǔ)GPU相結合,可(kě)進(jìn)行基于(yú)人(rén)工智能(néng)技術(shù)对(duì)信号(hào)進(jìn)行分(fēn)析處(chù)理(lǐ),解(jiě)決無線(xiàn)電(diàn)頻率管(guǎn)制、偵察、对(duì)抗中的(de)弱(ruò)信号(hào)、多(duō)模式、調制識别以(yǐ)及(jí)个(gè)體(tǐ)識别、信号(hào)智能(néng)處(chù)理(lǐ)技術(shù)。

bhSDR AI是一(yī)个(gè)基于(yú)bhSDR软(ruǎn)件(jiàn)無線(xiàn)電(diàn)平台進(jìn)行訓練與(yǔ)部(bù)署(shǔ)AI系(xì)統的(de)框架,核心目标(biāo)是为(wèi)開(kāi)發(fà)、訓練和(hé)實(shí)際部(bù)署(shǔ)人(rén)工智能(néng)驅動(dòng)的(de)信号(hào)處(chù)理(lǐ)系(xì)統提(tí)供高(gāo)效支撐。該框架深度(dù)整合了(le)靈活的(de)SDR硬(yìng)件(jiàn)接口(kǒu)與(yǔ)先(xiān)進(jìn)的(de)AI模型開(kāi)發(fà)流程(涵蓋數據(jù)采集、預處(chù)理(lǐ)、模型構建、訓練、验(yàn)證及(jí)嵌入(rù)式部(bù)署(shǔ)全环(huán)节(jié)),顯著降低(dī)了(le)将人(rén)工智能(néng)算法(fǎ)應(yìng)用(yòng)于(yú)複雜電(diàn)磁信号(hào)領域的(de)技術(shù)門(mén)檻與(yǔ)開(kāi)發(fà)周期(qī)。

功能(néng)特(tè)點(diǎn)
硬(yìng)件(jiàn)平台

UCRP4320以(yǐ)XILINX XCZU19EG SOC为(wèi)核心,集成(chéng)NVIDIA Jetson Orin NX AI模块(kuài),構建智能(néng)信号(hào)處(chù)理(lǐ)闭环(huán)。通(tòng)过(guò)双(shuāng)ADRV9009射頻芯片(piàn)實(shí)現(xiàn)4T4R全双(shuāng)工通(tòng)信,支持(chí)200MHz瞬时(shí)带(dài)宽(kuān)與(yǔ)Sub 6GHz全頻段(duàn)覆蓋。結合AI實(shí)时(shí)推理(lǐ)引擎,平台可(kě)完成(chéng)信号(hào)調制識别、射頻指紋識别、頻譜异(yì)常檢測、自(zì)适應(yìng)波(bō)束(shù)成(chéng)形等任務(wù),顯著提(tí)升(shēng)5G/6G、雷(léi)达(dá)、電(diàn)子战等场(chǎng)景的(de)智能(néng)化(huà)水(shuǐ)平。

UCRP6330以(yǐ)XILINX XCZU19EG SOC为(wèi)核心,集成(chéng)NVIDIA Jetson AGC Orin AI模块(kuài),構建智能(néng)信号(hào)處(chù)理(lǐ)闭环(huán)。通(tòng)过(guò)双(shuāng)ADRV9026射頻芯片(piàn)實(shí)現(xiàn)8T8R全双(shuāng)工通(tòng)信,支持(chí)200MHz瞬时(shí)带(dài)宽(kuān)與(yǔ)Sub 6GHz全頻段(duàn)覆蓋。結合AI實(shí)时(shí)推理(lǐ)引擎,平台可(kě)完成(chéng)信号(hào)調制識别、射頻指紋識别、頻譜异(yì)常檢測、自(zì)适應(yìng)波(bō)束(shù)成(chéng)形等任務(wù),顯著提(tí)升(shēng)5G/6G、雷(léi)达(dá)、電(diàn)子战等场(chǎng)景的(de)智能(néng)化(huà)水(shuǐ)平。

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基礎功能(néng)

bhSDR AI Stack的(de)基礎功能(néng)是通(tòng)过(guò)提(tí)供的(de)應(yìng)用(yòng)程序編程接口(kǒu)(API)實(shí)現(xiàn) bhSDR設備的(de) 數據(jù)通(tòng)信和(hé)參數控制,支持(chí)用(yòng)于(yú)模型訓練的(de)射頻數據(jù)采集、模型部(bù)署(shǔ)等機(jī)器學(xué)習工作(zuò)任務(wù)以(yǐ)及(jí)控制射頻信号(hào)發(fà)射和(hé)接收(shōu)等软(ruǎn)件(jiàn)定(dìng)義無線(xiàn)電(diàn)功能(néng)。

C/C++和(hé)Python是當前(qián)主(zhǔ)要(yào)支持(chí)的(de)編程语言;在(zài)SDR內(nèi)部(bù),參數是通(tòng)过(guò)以(yǐ)太网(wǎng)進(jìn)行控制,數據(jù)通(tòng)过(guò)PCIe進(jìn)行傳輸,以(yǐ)提(tí)供低(dī)时(shí)延的(de)數據(jù)傳輸。


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FPGA信号(hào)預處(chù)理(lǐ)

FPGA信号(hào)預處(chù)理(lǐ)提(tí)供FFT、FIR、DDC、DUC、信道(dào)化(huà)等功能(néng),这(zhè)些(xiē)模块(kuài)的(de)應(yìng)用(yòng)提(tí)高(gāo)了(le)整个(gè)系(xì)統的(de)吞吐量(liàng)及(jí)时(shí)延,可(kě)以(yǐ)更(gèng)加高(gāo)效的(de)執行AI驅動(dòng)的(de)算法(fǎ)和(hé)並(bìng)行處(chù)理(lǐ)任務(wù)。


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模型邊(biān)緣部(bù)署(shǔ)

基于(yú)bhSDR AI Stack软(ruǎn)件(jiàn)包(bāo),支持(chí)ONNX及(jí)TensorRT引擎推理(lǐ)。在(zài)大(dà)模型訓練完成(chéng)后,可(kě)以(yǐ)将模型轉(zhuǎn)換为(wèi)ONNX模型或(huò)者(zhě)TensorRT的(de)模型類(lèi)型,並(bìng)最(zuì)終(zhōng)将模型部(bù)署(shǔ)到(dào)bhSDR平台,實(shí)現(xiàn)模型的(de)邊(biān)緣部(bù)署(shǔ)。


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調制類(lèi)型識别

基于(yú)bhSDR AI Stack软(ruǎn)件(jiàn)包(bāo),本(běn)公(gōng)司提(tí)供一(yī)个(gè)調制類(lèi)型識别的(de)案(àn)例,該案(àn)例包(bāo)括从數據(jù)采集、模型訓練、模型優化(huà)及(jí)模型部(bù)署(shǔ)等整个(gè)深度(dù)學(xué)習全流程,可(kě)加速客戶智能(néng)無線(xiàn)電(diàn)系(xì)統的(de)原型验(yàn)證與(yǔ)産品化(huà)進(jìn)程。

該案(àn)例对(duì)5種(zhǒng)調制類(lèi)型(BPSK、QPSK、QAM16、AM、FM) 進(jìn)行實(shí)时(shí)識别,验(yàn)證AI模型在(zài)真(zhēn)實(shí)電(diàn)磁环(huán)境中的(de)性(xìng)能(néng),該模型的(de)準确率高(gāo)达(dá)94.2%。


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bhSDR AI Stack

bhSDR AI Stack是bhSDR AI硬(yìng)件(jiàn)平台的(de)软(ruǎn)件(jiàn)包(bāo),包(bāo)括硬(yìng)件(jiàn)平台運行需要(yào)的(de)所(suǒ)有(yǒu)組件(jiàn),

例如(rú)Ubuntu操作(zuò)系(xì)統、FPGA固件(jiàn)、設備驅動(dòng)、深度(dù)學(xué)習框架及(jí)常用(yòng)信号(hào)處(chù)理(lǐ)庫等。該软(ruǎn)件(jiàn)包(bāo)提(tí)供提(tí)供以(yǐ)下(xià)功能(néng):

基礎功能(néng):射頻參數配置與(yǔ)读(dú)取(qǔ),通(tòng)过(guò)PCle接收(shōu)發(fà)送數據(jù) 

人(rén)工智能(néng):支持(chí)深度(dù)學(xué)習開(kāi)發(fà)环(huán)境,預裝(zhuāng)TensorFlow/PyTorch,開(kāi)機(jī)即用(yòng) 

信号(hào)預處(chù)理(lǐ):提(tí)供FPGA加速信号(hào)預處(chù)理(lǐ),包(bāo)括FFT、DDC、DUC等

信号(hào)處(chù)理(lǐ):支持(chí)信号(hào)處(chù)理(lǐ)接口(kǒu) 

支持(chí)SoapySDR API接口(kǒu) 

提(tí)供C/C++、Python接口(kǒu) 

提(tí)供深度(dù)學(xué)習開(kāi)發(fà)整套(tào)流程開(kāi)發(fà)案(àn)例 

宽(kuān)带(dài)信号(hào)檢測、調制識别、信道(dào)編码識别、信号(hào)種(zhǒng)類(lèi)識别、辐射源个(gè)體(tǐ)識别


整个(gè)软(ruǎn)件(jiàn)包(bāo)結構如(rú)下(xià)图(tú)所(suǒ)示:

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UCRP4320 硬(yìng)件(jiàn)框图(tú)

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USRP6330硬(yìng)件(jiàn)框图(tú)

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武漢分(fēn)公(gōng)司地(dì)址:武漢市(shì)東(dōng)湖(hú)新技術(shù)開(kāi)發(fà)區(qū)武漢软(ruǎn)件(jiàn)新城(chéng)二(èr)期(qī)C9栋2层(céng)
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